大话计算机 计算机系统底层架构极限剖析(1-3) 操作系统 冬瓜哥 新华正版
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作者:
冬瓜哥
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出版社:
清华大学出版社
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ISBN:
9787302526476
-
出版时间:
2019-05
-
版次:
1
-
装帧:
其他
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开本:
16开
-
页数:
1540页
-
字数:
3546千字
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出版时间:
2019-05
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版次:
1
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装帧:
其他
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开本:
16开
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页数:
1540页
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字数:
3546千字
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上书时间2023-07-29
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商品描述：
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主编：
计算机，已经无处不在，你走到任何位置，都会有成千上万各种类型的“计算机”围绕着你，小到各种移动设备，大到飞机火车，都是由各种计算机控制并运转。你可曾想过这些计算机是怎么运作的？一个字节是怎么产生又是怎么消亡的？网络是如何连接的？人工智能到底是什么？冬瓜哥其人，喜钻研，擅用与科班教材截然不同的方式把计算机细细分解，娓娓道来。这本书如此通俗，以至于设当代文明毁灭之后，下一个文明从地壳中找到这本书，按照书中所讲即可迅速建立起计算机体系，极大推动下一个文明的进程
目录：
开篇 苦想计算机——以使用者的名义
章 电控开关——计算机世界的基石
1.1 十余年的迷惑 4
1.2 从1+1=2说起 4
1.2.1 用电路实现1+1=2 6
1.2.2 或门 6
1.2.3 与门 7
1.2.4 非门和与非门 7
1.2.5 异或门 7
1.2.6 1位加器 8
1.2.7 全手动1位加机 10
1.2.8 实现多位加器 10
1.2.9 电路的时延 13
1.2.10 新世界的新规律 13
1.2.11 先行/并行进位 14
1.2.12 电路化简和变换 15
1.3 我们需要真正可用的计算器 16
1.3.1 产生记忆 17
1.3.2 解决按键问题 18
1.3.3 数学的懵懂 22
1.3.4 次理解数学 25
1.3.5 次理解语义 27
1.3.6 七段显示数码管 30
1.3.7 野路子乘器 31
1.3.8 科班乘器 35
1.3.9 数据交换器crossbar 36
1.3.10 多媒体声光按键转码器 39
1.3.11 次驾驭时间 41
1.4 信息与信号 44
1.4.1 录制和回放 44
1.4.2 振动和信号 49
1.4.3 低通滤波 52
1.4.4 高通滤波 56
1.4.5 带通滤波 59
1.4.6 带阻滤波 59
1.4.7 傅里叶变换 59
1.4.8 波动与电磁波 60
1.4.9 载波、调制与频分复用 62
1.5 完整的计算器 68
1.5.1 用时序控制增强用户体验 69
1.5.2 用mux来实现crossbar 71
1.5.3 奇妙的fifo队列 73
1.5.4 同步/异步fifo 76
1.5.5 全局共享fifo 77
1.5.6 多路仲裁 78
1.5.7 交换矩阵 79
1.5.8 时序问题的产生与触发器 84
1.5.9 擒纵机构与触发器 86
1.5.10 擒纵机构与晶振 87
1.5.11 serdes与mux/demux 90
1.5.12 计算离不开数据传递 90
1.5.13 几个专业概念的由来 91
1.5.13.1 输入设备 91
1.5.13.2 输出设备 91
1.5.13.3 计算单元/运算器 91
1.5.13.4 控制单元和传递通路 91
1.5.13.5 反馈 91
1.5.13.6 运算/计算 94
1.5.13.7 数据通路和控制通路 94
1.5.13.8 组合逻辑和时序逻辑 94
1.5.13.9 寄存器/ latch/触发器/锁存器 94
1.5.13.10 存储器 94
1.5.13.11 地址/指针 95
1.5.13.12 写使能信号 95
1.6 多功能计算器 95
算术逻辑单元 96
第2章 解脱人手——程序控制计算机
2.1 从累积计算说起 98
2.2 自动执行 101
2.2.1 将作方式的描述转化为指令 102
2.2.2 实现那只鱿鱼——控制通路及部件 104
2.2.3 动起来吧！——时序通路及部件 108
2.2.4 半自动执行！——你得推着它跑 112
2.2.5 全自动受控执行！——不用扬鞭自奋蹄！ 113
2.2.6 noop指令 115
2.2.7 利用边沿型触发器搭建电路 116
2.2.8 分步图解指令的执行过程 121
2.2.9 判断和跳转 123
2.2.10 再见，章鱼先生！ 126
2.3 更高效的执行程序 128
2.3.1 利用循环缩减程序尺寸 128
2.3.2 实现更多方便的指令 131
2.3.3 多时钟周期指令 133
2.3.4 微指令和微码 136
2.3.5 全局地址空间 138
2.3.6 多端存储器 138
2.3.7 多级缓存与cpu 139
2.3.8 数据遍布各处 142
2.3.9 降低数据作粒度 145
2.3.10 取指令/数据缓冲加速 147
第3章 开关的进化——从机械到芯片
3.1 从薄铁片到机械计算机 150
3.1.1 算盘和计算尺 150
3.1.2 不可编程手动机械十进制计算机 151
3.1.3 可编程自动机械十进制计算机 152
3.1.4 可编程自动电动机械二进制计算机 156
3.1.5 可编程自动全电动二进制计算机 162
3.2 电子管时代 166
3.2.1 二极电子管 166
3.2.2 三极电子管 170
3.2.3 am广播 172
3.2.4 电子管计算机 174
3.2.5 石头会唱歌 177
3.3 固态——晶体管 179
3.3.1 p/n结与晶体管 181
3.3.2 场效应管（fet） 183
3.3.3 mosfet 185
3.3.4 cmos 186
3.3.5 晶体管计算机 187
3.4 制造工艺——集成电路 190
3.4.1 量产晶体管 190
3.4.2 跟冬瓜哥学做p/n结蛋糕 192
3.4.3 提升集成度 196
3.4.4 芯片内的深邃世界 197
3.4.5 cmos集成电路工艺概述 200
3.4.6 cmos工艺步骤概述 203
3.4.7 cmos工艺详细步骤 206
3.4.7.1 热氧化 207
3.4.7.2 氮化硅积淀 207
3.4.7.3 浅槽隔离蚀刻 208
3.4.7.4 pmos和nmos生成 209
3.4.7.5 触点电极的生成 213
3.4.7.6 通孔和支撑柱（via）的生成 214
3.4.7.7 层导线连接 216
3.4.7.8 第二层导线连接 216
3.4.7.9 表面钝化 217
3.4.8 半导体工艺的瓶颈 220
3.4.8.1 寄生电容 220
3.4.8.2 静态/动态功耗 221
3.4.8.3 栅氧厚度和high-k材料 222
3.4.8.4 导线连接和low-k材料 222
3.4.8.5 驱动能力及时延 222
3.4.8.6 时钟树 224
3.4.9 集成电路计算机 224
3.4.10 微处理器计算机 227
3.4.11 暴力拆解奔三cpu 230
3.5 存储器：不得不说的故事 232
3.5.1 机械存储器 233
3.5.1.1 声波/扭力波延迟线（delay line） 233
3.5.1.2 磁鼓存储器（drum） 234
3.5.1.3 磁芯存储器（core） 235
3.5.2 电子存储器 238
3.5.2.1 静态存储器（sram） 238
3.5.2.2 动态存储器（dram） 241
3.5.2.3 flash闪存 246
3.5.2.4 只读存储器（rom） 248
3.5.3 光存储器 248
3.5.3.1 光盘是如何存储数据的 248
3.5.3.2 压盘与刻盘的区别 250
3.5.3.3 光盘表面微观结构 250
3.5.3.4 多层记录 251
3.5.3.5 激光头的秘密 251
3.5.3.6 蓝光光盘简介 252
3.5.4 不同器件担任不同角 253
3.5.4.1 寄存器和缓存 253
3.5.4.2 主运行内存/主存 253
3.5.4.3 scratchpad ram 254
3.5.4.4 内容寻址内存cam/tcam 254
3.5.4.5 外存 257
第4章 电路执行过程的进化——流水线、分支预测、乱序执行与多发射
4.1 大话流水线 260
4.1.1 不高兴的译码器 260
4.1.2 思索流水线 263
4.1.2.1 流水线的本质是并发 263
4.1.2.2 不同时延的步骤混杂 264
4.1.2.3 大话队列 266
4.1.2.4 流水线的应用及优化 268
4.2 优化流水线 270
4.2.1 拆分慢速步骤 270
4.2.2 放置多份慢速部分 272
4.2.3 加入缓冲队列 273
4.2.4 图解五级流水线指令执行过程 273
4.3 流水线冒险 273
4.3.1 访问与流水线阻塞 278
4.3.2 数据依赖与数据前递 281
4.3.3 跳转冒险与分支预测 285
4.4 指令的动态调度 293
4.4.1 结构相关与寄存器重命名 293
4.4.2 保留站与乱序执行 295
4.4.3 分步图解乱序执行 297
4.4.4 重排序缓冲与指令顺序提交 319
4.5 物理并行执行 320
4.5.1 超标量和多发射 320
4.5.2 vliw超长指令字 322
4.5.3 simd单指令多数据 322
4.6 小结 326
第5章 程序世界——从机器码到作系统
5.1 基本的数据结构 330
5.1.1 数组 330
5.1.2 数据类型与ascii码 331
5.1.3 结构体 333
5.1.4 数据怎么摆放很重要 333
5.2 语言 335
5.2.1 简单的声明和赋值 335
5.2.2 编译和编译器 336
5.2.3 向编译器描述数据的编排方式 337
5.2.4 语言编程小试牛刀 339
5.2.5 人脑编译忆苦思甜 341
5.3 浮点数及浮点运算 342
5.3.1 数值范围和精度 342
5.3.2 浮点数的用处和表示方 343
5.3.3 浮点数的二进制表示 344
5.3.3.1 二进制浮点数转十进制小数 344
5.3.3.2 十进制小数转二进制浮点数 345
5.3.3.3 负指数和0的表示 346
5.3.3.4 无穷与非规格化数的表示 346
5.3.4 浮点数运算挺费劲 347
5.3.5 浮点数的c语言声明 349
5.3.6 十六进制表示 349
5.4 程控多媒体计算机 350
5.4.1 键盘是前提 350
5.4.2 搜索并显示 351
5.4.3 实现简易计算器 354
5.4.4 录入和保存 355
5.4.5 简易文件系统 356
5.4.6 计时/定时 360
5.4.7 发声控制 367
5.4.8 图像显示 369
5.4.9 网络聊天 372
5.5 程序社会 376
5.5.1 函数和调用 377
5.5.2 设备驱动程序 381
5.5.3 函数之间的联络站 388
5.5.4 库和链接 397
5.5.4.1 静态库和静态链接 399
5.5.4.2 头文件 404
5.5.4.3 api和sdk 406
5.5.4.4 动态库和动态链接 409
5.5.4.5 库文件/可执行文件的格式 410
5.5.5 程序的执行和退出 412
5.5.5.1 初步解决地址问题 413
5.5.5.2 更好的人机交互方式 413
5.5.5.3 程序的退出 414
5.5.5.4 使用外部设备和内存 416
5.5.6 多程序并发执行 417
5.5.6.1 利用时钟中断来切换线程 418
5.5.6.2 更广泛地使用中断 421
5.5.6.3 虚拟地址空间与分页 421
5.5.6.4 虚拟与现实的边界——系统调用 426
5.5.7 呼唤作系统 428
第6章 多处理器微体系结构——多核心与缓存
6.1 从超线程到多核心 430
6.1.1 超线程并行 430
6.1.2 多核心/多cpu并行 433
6.1.3 idle线程 434
6.1.4 乱序执行还是smt？ 435
6.1.5 逆超线程？ 436
6.1.6 线程与进程 436
6.1.7 多核心访存基本拓扑 437
6.2 缓存十九式 442
6.2.1 缓存是分级的 442
6.2.2 缓存是透明的 442
6.2.3 缓存的容量、频率和延迟 443
6.2.4 私有缓存和共享缓存 443
6.2.5 inclusive模式和exclusive模式 444
6.2.6 dirty标记位和valid标记位 444
6.2.7 缓存行 445
6.2.8 全关联/直接关联/组关联 446
6.2.9 用虚拟地址查缓存 451
6.2.10 缓存的同名问题 453
6.2.11 缓存的别名问题 453
6.2.12 页面着 455
6.2.13 小结及商用cpu的缓存模式 457
6.2.14 缓存对写入作的处理 458
6.2.15 load/stor queue与stream buffer 459
6.2.16 非阻塞缓存与mshr 460
6.2.17 缓存行替换策略 462
6.2.18 i_cache/d_cache/tlb_ cache 463
6.2.19 对齐和伪共享 465
6.3 关联起来，为了一致 465
6.3.1 crossbar交换矩阵 466
6.3.2 ring 472
6.3.3 noc 475
6.3.4 众核心cpu 478
6.3.5 多核心程序执行过程回顾 481
6.3.6 在众核心上执行程序 482
6.4 存储器在网络中的分布 484
6.4.1 cpu片内访存网络与存储器分布 487
6.4.2 cpu片外访存网络 489
6.4.2.1 全线拓扑及南桥与北桥 490
6.4.2.2 amd athlon北桥 492
6.4.2.3 常用网络拓扑及uma/numa 494
6.4.2.4 amd opteron北桥 497
6.4.3 参悟全局共享内存架构 499
6.4.4 访存网络的硬分区 501
6.5 qpi片间互联网络简介 502
6.5.1 qpi物理层与同步异步通信 503
6.5.2 qpi链路层网络层和消息层 505
6.5.3 qpi的初始化与系统启动 507
6.5.3.1 链路初始化和拓扑发现 507
6.5.3.2 系统启动 507
6.5.4 qpi的扩展 509
6.6 基于qpi互联的高端服务器架构一览 510
6.6.1 某32路cpu高端主机 510
6.6.2 dellemc的双层主板qpi互联 511
6.6.3 ibm x3850/3950 x5/x6主机 511
6.6.4 hp superdome2主机 515
6.6.5 fujitsu pq2k主机 518
6.7 理解多核心访存时空一致问题 520
6.7.1 访存空间一致问题 520
6.7.2 访存时间一致问题 521
6.7.2.1 延迟到达导致的错乱 521
6.7.2.2 访问导致的错乱 521
6.7.2.3 提前执行导致的错乱 522
6.7.2.4 乱序执行导致的错乱 522
6.8 解决多核心访存时间一致问题 523
6.8.1 互斥访问 523
6.8.2 让子弹飞 526
6.8.3 硬件原生保证的基本时序 527
6.8.4 解决延迟到达错乱问题 529
6.8.5 解决访问错乱问题 530
6.8.6 解决提前执行测错乱问题 530
6.8.7 解决乱序执行错乱问题 531
6.8.8 小结 531
6.9 解决多核心访存空间一致问题 533
6.9.1 基于线的缓存一致实现 533
6.9.1.1 snarfing/write sync方式 533
6.9.1.2 write invalidate方式 534
6.9.2 推导mesif状态机 535
6.9.3 moesi状态机 540
6.9.4 结合mesif协议进一步理解锁和屏障 540
6.9.5 结合mesif深刻理解时序一致模型 545
6.9.5.1 一致（uc） 545
6.9.5.2 严格一致（sc） 545
6.9.5.3 顺序一致（sec） 545
6.9.5.4 处理器一致（pc） 546
6.9.5.5 弱一致（wc） 546
6.9.6 缓存行并发写优化 546
6.9.7 cache agent的位置 547
6.9.8 基于共享线的过滤机制 548
6.9.8.1 bitmap粗略过滤 549
6.9.8.2 向量bitmap准确过滤 549
6.9.8.3 布隆过滤器与散列采样 550
6.9.8.4 jetty filter 551
6.9.8.5 流寄存器式过滤器 553
6.9.8.6 带计数器的sr过滤器 554
6.9.8.7 蓝基因/p中的过滤器 554
6.9.9 基于分布式访存网络的缓存一致实现 555
6.9.9.1 分布式网络对cc机制的影响 557
6.9.9.2 多级缓存和多cpu对cc机制的影响 558
6.9.9.3 即便无锁也要保证一致 558
6.9.10 分布式网络下的过滤机制 559
6.9.10.1 在llc中增设bitmap向量过滤片内广播 559
6.9.10.2 ring网络的三种方式 561
6.9.10.3 增设远程目录过滤片外广播 562
6.9.10.4 利用ha代理片内cc事务 565
6.9.10.5 小结 569
6.9.10.6 在网络路径上实施过滤 570
6.9.11 缓存一致实现实际案例 571
6.9.11.1 intel blackford北桥cc实现 572
6.9.11.2 amd opteron 800台cc实现 573
6.9.11.3 北桥与nc（node controller） 575
6.9.11.4 horus nc实现 576
6.9.11.5 sgi origin 2000 nc实现 580
6.9.11.6 ibm percs超级计算机中的nc 583
6.9.11.7 intel cpu在qpi网络下的cc实现 585
6.9.11.8 小结 588
第7章 计算机i/o子系统
7.1 计算机i/o的基本套路 593
7.1.1 programmed io+polling模式 593
7.1.2 dma+中断模式 598
7.1.3 dma与缓存一致 600
7.1.4 scatter/gather list（sgl） 601
7.1.5 使用队列提升i/o能 601
7.1.6 固件/firmware 604
7.1.6.1 固件与os的区别与联系 605
7.1.6.2 固件的层次 605
7.1.6.3 固件的格式 605
7.1.6.4 固件存在哪 605
7.1.6.5 固件如何加载运行 606
7.1.7 网络i/o基本套路 606
7.1.8 接入更多外部设备 610
7.1.9 一台完整计算机的全貌 614
7.2 中断处理 6
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